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          AMD Zen3 3D堆疊緩存細(xì)節(jié):互連帶寬提升15倍

          2021-08-23 16:27:52來源:快科技 關(guān)鍵詞:存儲(chǔ)存儲(chǔ)設(shè)備閱讀量:21017

          導(dǎo)讀:AMD使用的技術(shù)叫做“3D Chiplet”(立體芯片),是在微凸點(diǎn)3D(Micro Bump 3D)技術(shù)的基礎(chǔ)上,結(jié)合硅通孔(TSV),應(yīng)用了混合鍵合(Hybrid Bonding)的理念,最終使得微凸點(diǎn)之間的距離只有區(qū)區(qū)9微米。
            先進(jìn)制程工藝的推進(jìn)越來越困難,成本也越來越高,半導(dǎo)體巨頭們紛紛把目光投降了各種封裝技術(shù)。
           
            Hot Chips 33大會(huì)上,AMD就第一次公開了3D V-Cache堆疊緩存的部分技術(shù)細(xì)節(jié)。
           
            AMD此前六月初在臺(tái)北電腦展上首次披露了這一技術(shù),利用一顆銳龍9 5900X 12核心處理器,每個(gè)CCD計(jì)算芯片上堆疊64MB SRAM作為額外的三級(jí)緩存,加上原本就有的64MB,合計(jì)達(dá)192MB,游戲性能因此可平均提升15%,堪比代際跨越。
           
            這一次,AMD首先羅列了各家的各種封裝技術(shù),包括Intel、臺(tái)積電、蘋果、三星、索尼等等,并強(qiáng)調(diào)之所以有如此豐富的封裝技術(shù),是因?yàn)闆]有一個(gè)方案能夠滿足所有產(chǎn)品需求,必須根據(jù)產(chǎn)品屬性來定制。
           
            AMD使用的技術(shù)叫做“3D Chiplet”(立體芯片),是在微凸點(diǎn)3D(Micro Bump 3D)技術(shù)的基礎(chǔ)上,結(jié)合硅通孔(TSV),應(yīng)用了混合鍵合(Hybrid Bonding)的理念,最終使得微凸點(diǎn)之間的距離只有區(qū)區(qū)9微米,相比于Intel未來的Foveros Direct封轉(zhuǎn)技術(shù)還縮短了1微米,結(jié)構(gòu)更加細(xì)致。
           
            AMD聲稱,3D Chiplet技術(shù)可將互連功耗降低至原來的1/3,換言之能效提升3倍,互聯(lián)密度則猛增15倍。總之,AMD 3D堆疊緩存并沒有使用全新創(chuàng)造的復(fù)雜封裝工藝,主要是基于現(xiàn)有技術(shù),針對(duì)性地加以改進(jìn)、融合,更適合自身產(chǎn)品,從而以最小的代價(jià),獲得明顯的性能提升,不失為一種高性價(jià)比策略。
           
            按照之前的說法,搭載3D V-Cache緩存的銳龍?zhí)幚砥鲗⒃诮衲甑琢慨a(chǎn),可能就是銳龍6000系列,而基于全新Zen4架構(gòu)的下一代產(chǎn)品,要到明年下半年了。
           
            (原標(biāo)題:AMD Zen3 3D堆疊緩存細(xì)節(jié):比Intel更細(xì)致、互連帶寬提升15倍
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